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[source in ebook] VHDL语言100例(普通下载)

Description: VHDL语言100例 VHDL语言100例第1例带控制端口的加法器第2例无控制端口的加法器第3例乘法器第4例比较器第5例二路选择器第6例寄存器第7例移位寄存器第8例综合单元库第9例七值逻辑与基本数据类型第10例函数第11例七值逻辑线或分辨函数第12例转换函数第13例左移函数第14例七值逻辑程序包第15例四输入多路器第16例目标选择器第17例奇偶校验器第18例映射单元库及其使用举第19例循环边界常数化测试第20例保护保留字第21例进程死锁第22例振荡与死锁第23例振荡电路第24例分辨信号与分辨函数第25例信号驱动源第26例属性TRANSACTION和分辨信号第27例块保护及属性EVENT, 第28例形式参数属性的测试第29例进程和并发语句第30例信号发送与接收第31例中断处理优先机制建模第32例过程限定第33例整数比较器及其测试第34例数据总线的读写第35例基于总线的数据通道第36例基于多路器的数据通道第37例四值逻辑函数第38例四值逻辑向量按位或运算第39例生成语句描述规则结构第40例带类属的译码器描述第41例带类属的测试平台第42例行为与结构的混合描述第43例四位移位寄存器第44例寄存／计数器第45例顺序过程调用第46例 VHDL中generic缺省值的使用第47例无输入元件的模拟第48例测试激励向量的编写第49例 delta延迟例释第50例惯性延迟分析第51例传输延迟驱动优先第52例多倍（次）分频器第53例三位计数器与测试平台第54例分秒计数显示器的行为描述6 第55例地址计数器第56例指令预读计数器第57例加.c减.c乘指令的译码和操作第58例 2－4译码器结构描述第59例 2－4译码器行为描述第60例转换函数在元件例示中的应用第61例基于同一基类型的两分辨类型的赋值相容问题第62例最大公约数的计算第63例最大公约数七段显示器编码第64例交通灯控制器第65例空调系统有限状态自动机第66例 FIR滤波器第67例五阶椭圆滤波器第68例闹钟系统的控制第69例闹钟系统的译码第70例闹钟系统的移位寄存器第71例闹钟系统的闹钟寄存器和时间计数器第72例闹钟系统的显示驱动器第73例闹钟系统的分频器第74例闹钟系统的整体组装第75例存储器第76例电机转速控制器第77例神经元计算机第78例ccAm2901四位微处理器的ALU输入第79例ccAm2901四位微处理器的ALU 第80例ccAm2901四位微处理器的RAM 第81例ccAm2901四位微处理器的寄存器第82例ccAm2901四位微处理器的输出与移位第83例ccAm2910四位微程序控制器中的多路选择器第84例ccAm2910四位微程序控制器中的计数器／寄存器第85例ccAm2910四位微程序控制器的指令计数器第86例ccAm2910四位微程序控制器的堆栈第87例 Am2910四位微程序控制器的指令译码器第88例可控制计数器第89例四位超前进位加法器第90例实现窗口搜索算法的并行系统（1）——协同处理器第91例实现窗口搜索算法的并行系统（2）——序列存储器第92例实现窗口搜索算法的并行系统（3）——字符串存储器第93例实现窗口搜索算法的并行系统（4）——顶层控制器第94例 MB86901流水线行为描述组成框架第95例 MB86901寄存器文件管理的描述第96例 MB86901内ALU的行为描述第97例移位指令的行为描述第98例单周期指令的描述第99例多周期指令的描述第100例 MB86901流水线行为模型
Platform: | Size: 344064 | Author: wfl.a@163.com | Hits:

[VHDL-FPGA-Verilog] VHDL CPU部件

Description: 包括一个简单的ALU和一些寄存器、ROM的设计。有一些以TXT文件格式存在，用的时候只要改一下格式即可。
Platform: | Size: 155537 | Author: terminatorsong@gmail.com | Hits:

[VHDL-FPGA-Verilog] VHDL语言ALU设计

Description: VHDL语言8位ALU设计
Platform: | Size: 1485929 | Author: kzelfxjj | Hits:

[VHDL-FPGA-Verilog] VHDL的基本数学运算库

Description: VHDL的基本数学运算库,非常好用-VHDL basic arithmetic library, a very handy! !
Platform: | Size: 232448 | Author: | Hits:

[VHDL-FPGA-Verilog] alu

Description: 硬件设计vhdl_cpu1,1. You may copy and distribute verbatim copies of this core, as long -- as this file, and the other associated files, remain intact and -- unmodified. Modifications are outlined below.-hardware design vhdl_cpu1, 1. You may copy and distribute verbatim copies of this core, as long-- as this file, and the other associated files, remain intact and-- unmodified. Modifications are outlined below.
Platform: | Size: 1024 | Author: 江浩 | Hits:

[VHDL-FPGA-Verilog] vhdl实现alu的源代码

Description: VHDL实现ALU的源代码，并且提供了一个详细的testbench！-ALU VHDL source code, and provide a detailed testbench!
Platform: | Size: 1024 | Author: 飞扬 | Hits:

[VHDL-FPGA-Verilog] alu

Description: 16位RISC CPU的ALU，使用VHDL编写-16-bit RISC CPU
Platform: | Size: 2048 | Author: 李斌 | Hits:

[VHDL-FPGA-Verilog] alu

Description: 4位ALU逻辑运算单元，可进行加法、减法、逻辑运算、移位等操作。-4 ALU logical operation unit, can be additive, subtraction, logic operations, shift and other operations.
Platform: | Size: 1024 | Author: 甲天下 | Hits:

[VHDL-FPGA-Verilog] alu

Description: 实现16种运算的alu,包括+,-,+1,-1,与或非以及移位比较运算。经调试成功。-16 kinds of computing realize alu, including+,-,+ 1,-1, compared with the non-as well as the shift operator. After the successful commissioning.
Platform: | Size: 411648 | Author: wangyangyang | Hits:

[VHDL-FPGA-Verilog] alu

Description: 4bit ALU（运算逻辑单元）的设计给出了此次设计alu的输入输出结构及相应的位数。其中C0是一位的进位输入，A和B分别是4位的数据输入，S0、S1、M分别为一位的功能选择输入信号；Cout是一位的进位输出，F是4为的运算结果输出。-4bit ALU (arithmetic logic unit) design is given in the design of alu input and output structure and the corresponding median. C0 which is a binary input of, A and B are four data entry, S0, S1, M, respectively, as a function of choice of the input signal Cout of a binary output, F is 4 for computing the results of output.
Platform: | Size: 1024 | Author: chenyi | Hits:

[ARM-PowerPC-ColdFire-MIPS] ALU

Description: ALU可以实现16种操作（包括加减乘除移位运算等）-ALU can be 16 kinds of operations (including addition and subtraction multiplication and division shift operator, etc.)
Platform: | Size: 838656 | Author: 草野彰 | Hits:

[source in ebook] alu

Description: 4位alu，包括加减乘除等运算功能，是可综合风格的，包括测试文件-4 alu, including computing functionality, such as addition and subtraction multiplication and division, is a comprehensive style, including the test file
Platform: | Size: 2048 | Author: polozhang | Hits:

[VHDL-FPGA-Verilog] ALU

Description: vhdl代码使用quartus编译 cpu中 alu的设计可作为课程设计的参考此为16的运算器-VHDL code using Quartus compiler cpu in alu design of curriculum design can be used as a reference for this for 16 computing device
Platform: | Size: 1024 | Author: 闵瑞鑫 | Hits:

[VHDL-FPGA-Verilog] ALU

Description: 在Xilinx7.1平台下编写的ALU代码，可以实现五位加法、减法、与、异或四种运算！-Xilinx7.1 platform in the preparation of the ALU code, can be achieved five adder, subtraction, and, four computing XOR!
Platform: | Size: 1024 | Author: 梁晓炬 | Hits:

[VHDL-FPGA-Verilog] alu

Description: 算术运算单元ALU的设计,才用VHDL语言编写,有仿真波形-vhdl alu
Platform: | Size: 94208 | Author: wer | Hits:

[Software Engineering] 8-bit-alu

Description: this is an 8 bit alu. to perform various arithmetic and logical operations
Platform: | Size: 1024 | Author: khan | Hits:

[VHDL-FPGA-Verilog] ALU

Description: 这是一个用vhdl语言实现的比较完整的ALU,可以用作其他cPU设计的部件-This is a vhdl language used to achieve complete ALU, can be used for other design components cPU
Platform: | Size: 195584 | Author: maxpayne | Hits:

[VHDL-FPGA-Verilog] ALU

Description: VHDL实现cpu核心逻辑与运算单元模块的实现，完成4bit*4bit输入8bit输出的运算，可做加减乘除逻辑移位6种操作-the implementation of Arithmetic and logic unit based on VHDL, can do as the adder,subtractor,multiplier,divider,shifter and logic operation.
Platform: | Size: 619520 | Author: caolei | Hits:

[VHDL-FPGA-Verilog] alu

Description: 这是32位alu的代码，使用verilog写的，包含了简单的运算功能-This is a 32-bit alu code, use verilog to write, and includes a simple arithmetic functions
Platform: | Size: 1024 | Author: 杨恋 | Hits:

[VHDL-FPGA-Verilog] ALU

Description: 用VHDL硬件描述语言写的ALU设计，有加法，减法，乘法和除法等计算功能。-VHDL hardware description language used to write the ALU design, there are addition, subtraction, multiplication and division such as computing.
Platform: | Size: 3072 | Author: 飞翔 | Hits:

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